1. RIUdeG
  2. Tesis
  3. Maestría
  4. CUCEI
Por favor, use este identificador para citar o enlazar este ítem: https://hdl.handle.net/20.500.12104/80009
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dc.contributor.advisorMedina Vázquez, Agustín
dc.contributor.authorArce Zavala, José Manuel
dc.date.accessioned2019-12-24T02:33:27Z-
dc.date.available2019-12-24T02:33:27Z-
dc.date.issued1969-12-31
dc.identifier.urihttps://hdl.handle.net/20.500.12104/80009-
dc.identifier.urihttps://wdg.biblio.udg.mx
dc.description.abstractEl proposito del presente trabajo es presentar el desarrollo de un correlador de señal mezclada en tecnologıa CMOS mediante el uso del transistor MOSFET de compuerta flotante de multiples entradas o MIFGMOS con la finalidad de obtener un circuito electronico VLSI para su fabricacion utilizando una tecnologıa estandar de 0.35 mm. Para el desarrollo de este sistema, se propone una arquitectura basada en una celda de correlacion implementada con un MIFGMOS de 513 entradas de control. En este documento se aborda todo el proceso de diseño, desde la propuesta de la arquitectura, pasando por la implementacion de las celdas individuales, incluyendo la celda de correlacion basada en MIFGMOS, hasta la validacion experimental del sistema propuesto. Adicionalmente, se muestra la aplicacion del sistema correlador en la implementaci on de un detector de señales piloto en un sistema de comuncaciones inalambricas
dc.description.tableofcontents1 INTRODUCCION 1.1 Objetivo 1.1.1 Objetivos especıficos 1.1.2 Hipotesis 1.2 Metodologıa 1.3 Contenido de la tesis 2 ANTECEDENTES 2.1 La correlacion 2.1.1 Correlacion cruzada 2.1.2 Auto-Correlacion 2.2 Aplicacion a la telefonıa celular 2.2.1 Acceso multiple por division de codigos CDMA 2.2.2 Codigos Walsh-Hadarmad 2.3 Transistor de compuerta flotante de multiples entradas MIFGMOS 2.3.1 La carga inicial 2.3.2 Inconveniente relacionado a la simulacion 2.4 Flujo de diseño 2.4.1 Requerimientos 2.4.2 Captura del esquematico 2.4.3 Simulacion 2.4.4 Edicion de layout 2.4.5 Extraccion y comparacion layout contra el esquematico 2.4.6 Fabricacion 3 IMPLEMENTACI ON 3.1 Arquitectura propuesta 3.2 Celda de coincidencia basada en el MIFGMOS 3.3 Especificacion de la arquitectura 3.3.1 Los registro de desplazamientos 3.3.2 El selector de ruta 3.3.3 La compuerta de flotante 3.3.4 El comparador 3.4 Simulacion de la arquitectura 3.5 Resultados de la simulacion 3.5.1 Simulacion para 128 bits 3.5.2 Simulacion para 256 bits 3.6 Construccion del circuito 4 RESULTADOS 4.1 Configuracion de las terminarles 4.2 Configuracion de los registros de desplazamiento 4.3 Casos de pruebas 4.3.1 Caso 1 4.3.2 Caso 2 4.3.3 Caso 3 4.3.4 Caso 4 4.3.5 Caso 5 4.3.6 Caso de secuencias no ortogonales 4.3.7 Caso mas ceros que unos 4.3.8 Caso para señal piloto 4.4 Comparacion entre simulacion y resultados experimentales 5 CONCLUSIONES A. PAR AMETROS DE LA TECNOLOGIA TSCM 0.35 MICR OMETROS A.1 65-INPUT MIFGMOS B. INTERFAZ MAT LAB C. MICROCONTROLADOR D. RESULTADOS ADICIONALES D.1 Algunos resultados extras D.2 Articulos presentados Referencias
dc.formatapplication/PDF
dc.language.isospa
dc.publisherBiblioteca Digital wdg.biblio
dc.publisherUniversidad de Guadalajara
dc.rights.urihttps://www.riudg.udg.mx/info/politicas.jsp
dc.subjectTecnologia Cmos
dc.subjectTransistor Mosfet De Compuerta Flotante De Multiples Entradas
dc.subjectMifgmos
dc.subjectCircuito Electronico Vlsi
dc.titleDiseño y Construcción de un Correlador de Señal Mixta en Circuito Integrado
dc.typeTesis de Maestria
dc.rights.holderUniversidad de Guadalajara
dc.rights.holderArce Zavala, José Manuel
dc.coverageGUADALAJARA, JALISCO
dc.type.conacytmasterThesis-
dc.degree.nameMAESTRIA EN CIENCIAS EN INGENIERIA ELECTRONICA Y COMPUTACION-
dc.degree.departmentCUCEI-
dc.degree.grantorUniversidad de Guadalajara-
dc.degree.creatorMAESTRO EN CIENCIAS EN INGENIERIA ELECTRONICA Y COMPUTACION-
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